Програмовані матриці логіки: відмінності між версіями

{{Стаття, з якої нема посилань|дата=грудень 2011}}

'''Програмовані матриці логіки (ПМЛ)(PAL)'''

ПМЛ має n парафазних входів а1 , а2 ,..., аn, матрицю І, матрицю АБО, m вихідних буферів та кола зворотного зв’язку. Матриця І програмована і дозволяє отримати на своїх виходах будь-які елементарні кон’юнкції змінних а1 , а2 ,..., аn. Виходи матриці І з’єднані із входами матриці АБО, яка створює диз’юнкції елементарних кон’юнкцій, сформованих матрицею І. Виходи матриці І називаються проміжними шинами (product terms) або термами (terms). На відзнаку від програмованих логічних матриць (ПЛМ або PLA) у ПМЛ матриця АБО має фіксовану настройку, за якої кожна проміжна шина матриці І з’єднана тільки з одним виходом. Це дозволяє реалізувати матрицю АБО у вигляді сукупності q-входових диз’юнкторів. Вихідні буфери являють собою програмовані макрокомірки МК, які й визначають архітектуру ПМЛ. Макрокомірки можуть складатися з вихідного інвертора з трьома станами (0, 1 і z-стан), тригерів різного типу.

 

{{Без категорій|дата=грудень 2011}}

 

[[ca:Programmable Array Logic]]